4 月 27 日消息，Ampere Computing 公司首席产品官 Jeff Wittich 近日接受采访时表示，将于今年晚些时候推出 AmpereOne-2，配备 12 个内存通道，改进性能的 A2 核心。
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AmpereOne-2 的 内存控制器数量将增加33%，内存带宽将增加多达50%。
此外该公司目前正在研究第三代AmpereOne-3 ，计划在 2025 年发布，拥有 256 个核心，采用台积电的 3nm（3N）工艺蚀刻。附上路线图如下：
将采用改进后的A2+核心，且每个核心采用双芯粒（Chiplets）设计，而每个小芯粒最高支持128个核心。
该网站预计 
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